- 論文誌
- [1]
金本俊幾, 佐藤高史, 黒川敦, 川上善之, 岡宏規, 北浦智靖, 小林宏行, 橋本昌宜, ``遅延計算におけるインダクタンスを考慮すべき配線の統計的選別手法,'' 情報処理学会論文誌, vol. 44, no. 5, pp. 1301-1310, May 2003.
- 国内会議(査読付き)
- [1]
小谷 憲, 増田弘生, 成木保文, 奥村隆昌, 城間 誠, 金本俊幾, 古川且洋, 山中俊輝, 小笠原泰弘, 佐藤高史, 橋本昌宜, 黒川敦, 田中正和, ``微細CMOSタイミング設計の新しいコーナー削減方法,'' 情報処理学会DAシンポジウム, pp. 193--198, August 2012.
- [2]
城間誠, 山中俊輝, 小笠原泰弘, 金本俊幾, 成木保文, 奥村隆昌, 増田弘生, 古川且洋, 佐藤高史, 橋本昌宜, 黒川敦, 田中正和, ``微細プロセス（22nm世代）における配線コーナー設計手法の検討,'' 情報処理学会DAシンポジウム, pp. 199--204, August 2012.
- [3]
佐方剛, 成木保文, 奥村隆昌, 金本俊幾, 増田弘生, 佐藤高史, 橋本昌宜, 古川且洋, 田中正和, 山中俊輝, ``CMOSドライバ回路遅延のNBTI劣化ばらつき特性解析,'' 情報処理学会DAシンポジウム, September 2011.
- [4]
増田弘生, 佐方剛, 佐藤高史, 橋本昌宜, 古川且洋, 田中正和, 山中俊輝, 金本俊幾, ``RTNを考慮した回路特性ばらつき解析方法の検討,'' 情報処理学会DAシンポジウム, pp. 209--214, September 2010.
- [5]
榎並孝司, 橋本昌宜, 佐藤高史, ``電源ノイズ考慮統計的タイミング解析を用いたデカップリング容量割当手法,'' 電子情報通信学会 VLSI設計技術研究会, no. VLD2008-161, March 2009.
- [6]
小林宏行、小野信任、佐藤高史、岩井二郎、橋本昌宜, ``統計的STA の精度検証手法,'' 情報処理学会DAシンポジウム, pp. 7-12, July 2006.
- [7]
佐藤高史, 金本俊幾, 黒川敦, 川上善之, 岡宏規, 北浦智靖, 池内敦彦, 小林宏行, 橋本昌宜, ``インダクタンスに起因する配線遅延変動の統計的予測手法,'' 2002年電子情報通信学会ソサイエティ大会講演論文集, no. TA-2-4, pp. 247-248, September 2002.
- [8]
佐藤高史, 金本俊幾, 黒川敦, 川上善之, 岡宏規, 北浦智靖, 池内敦彦, 小林宏行, 橋本昌宜, ``インダクタンスが配線遅延に及ぼす影響の定量的評価方法,'' 第15回 回路とシステム(軽井沢)ワークショップ, pp. 493-498, April 2002.
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