尾上研究室 研究業績一覧: K. Miyanohana, G. Fujita, K. Yanagida, T. Onoye, and I. Shirakawa, VLSI Implementation of Single Chip Encoder/Decoder for Low Bitrate Visual Communication, May 1997.
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K. Miyanohana, G. Fujita, K. Yanagida, T. Onoye, and I. Shirakawa, "VLSI Implementation of Single Chip Encoder/Decoder for Low Bitrate Visual Communication," In in Proc. IEEE Custom Integrated Circuits Conference, pp. 229-232, May 1997.
ID 80
分類 国際会議
タグ
表題 (title) VLSI Implementation of Single Chip Encoder/Decoder for Low Bitrate Visual Communication
表題 (英文)
著者名 (author) K. Miyanohana, G. Fujita, K. Yanagida, T. Onoye, I. Shirakawa
英文著者名 (author)
編者名 (editor)
編者名 (英文)
キー (key) Koji Miyanohana, Gen Fujita, Kazuhiro Yanagida, Takao Onoye, Isao Shirakawa
書籍・会議録表題 (booktitle) in Proc. IEEE Custom Integrated Circuits Conference
書籍・会議録表題(英文)
巻数 (volume)
号数 (number)
ページ範囲 (pages) 229-232
組織名 (organization)
出版元 (publisher)
出版元 (英文)
出版社住所 (address)
刊行月 (month) 5
出版年 (year) 1997
採択率 (acceptance)
URL
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内容梗概 (abstract)
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