尾上研究室 研究業績一覧: S. Watanabe, M. Hashimoto, and T. Sato, A Case for Exploiting Complex Arithmetic Circuits Towards Performance Yield Enhancement, March 2009.
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S. Watanabe, M. Hashimoto, and T. Sato, "A Case for Exploiting Complex Arithmetic Circuits Towards Performance Yield Enhancement," In Proceedings of International Symposium on Quality Electronic Design (ISQED), pp. 401--407, March 2009.
ID 602
分類 国際会議
タグ
表題 (title) A Case for Exploiting Complex Arithmetic Circuits Towards Performance Yield Enhancement
表題 (英文)
著者名 (author) S. Watanabe,M. Hashimoto,T. Sato
英文著者名 (author)
編者名 (editor)
編者名 (英文)
キー (key)
書籍・会議録表題 (booktitle) Proceedings of International Symposium on Quality Electronic Design (ISQED)
書籍・会議録表題(英文)
巻数 (volume)
号数 (number)
ページ範囲 (pages) 401--407
組織名 (organization)
出版元 (publisher)
出版元 (英文)
出版社住所 (address)
刊行月 (month) 3
出版年 (year) 2009
採択率 (acceptance)
URL
付加情報 (note)
注釈 (annote)
内容梗概 (abstract)
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BiBTeXエントリ
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